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最新的FPGA主站性能测试

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发表于 2017-7-14 16:59:42 | 显示全部楼层 |阅读模式
少啰嗦,先看东西

//2018-04-08 更新
支持指定的倍福DC的IO模块。(EK1100+EL2258(8通道DO)+EL1258(8通道DI))。这个阶段,主站支持32个伺服驱动器或者15个倍福数字IO共120路。

//2017-12-15 更新
重新对主站的系统时间进行优化,周期缩小到125us,测试了500us,250us,125us, 抖动 -80ns < jitter < +40ns


/***************************华丽的分割线***************************/
1、CSP模式下,500us周期,抖动 -22us < jitter < + 25us



2、CSP模式下,250us周期,抖动 -11us <jitter < +12us





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发表于 2018-3-21 14:55:32 | 显示全部楼层
抖动是看的速度的抖动吗?是由哪个变量画的图?
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